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Néanmoins, contrairement à Steve Ballmer, Paul Otellini n’a pas jeté de chaise en profanant des menaces de mort, bien au contraire, la firme de Santa Clara montre la plus grande indifférence au lendemain de cette série d’embauches.
La question que tout le monde se pose maintenant est de savoir ce qu’AMD a en réserve pour ses nouveaux venus.
Source : Daily Tech
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normal qu'ils fassent les indifférents, doivent être bien contents de se débarasser des mecs qui ont pondu cte saloperie de CPU ^^
en quoi c'est une saloperie ? (outre le fait que ça soit un peu un echec commercial)
rapport perf/prix complètement a la ramasse, véritable poële a frire (ce truc est un cauchemard a refroidir, même un alpha 21264 pose moins souci), gouffre sans fond en R&D et pour les developpeurs qui ont tenté de faire qqchose dessus
et pis surtout ils ont flingué l'alpha pour faire de la place a ce truc, ca c un sacrilège
Peut-être que le 10ème resté chez Intel est responssable de tout les défauts? On peut rêver...
Ou peut etre qu'INTEL les a envoyé en tant qu'agents infiltrés...
Ou peut etre qu'INTEL en a fait de même en allant cherché qques personnes chez AMD ( ou prévu de le faire )
meuuuh non ils sont juste en formation pour faire du 64b
Itanium est un superbe CPU avec des perfs redoutables.

Ca chauffe, et alors ?
Malheureusement, le genre de CPU qui aurait mérité un vrai OS dédié.
Pour la question, j'aurai plutôt inversé : savoir ce que ces nouveaux venus ont en réserve pour AMD.
On dit proférer et pas profaner des menaces de mort...
y a pas mal de personne de chez Intel qui se sont aussi retrouver chez Cadence
Java> non, pas performances redoutables. Correctes, en regard du prix, des désagréments techniques et surtout trop de recherche et de conception pour finalement peu d'applications sur le terrain.
Ceci dit, technologiquement parlant, ce n'est pas une bouse. Mais bon, tout le monde attendait bien mieux et au fond, c'est un peu le pétard mouillé d'Intel dans ce domaine...
Les itanium, c surtout une micro architecture CPU différente mise en oeuvre: le VLIW (very long instruction word) au lieu du RISC "classique". L'inconvénient principal est la forte dépendance du CPU au compilateur (pas de out-of-order -> + rapide si le compilo est bien foutu).
En théorie, un CPU VLIW devrait consommer moins qu'un RISC.
Mais en fait les itanium ne sont pas des "vrais" VLIW mais hybrides (EPIC derive du VLIW).
Autre CPU VLIW qui a eu ses heures de gloire: les Crusoe de Transmetta.
+ d info sur wikipedia: http://en.wikipedia.org/wiki/Very_ [...] ction_word
Pour en revenir à la news, 9/10 dev, cela parrait énorme!
On peut esperer pour AMD que ces ingé apporteront des bonnes idées pour la prochaine architecture.
La fameuse précédante recrue du style était les ingé alpha emauché par AMD et qui ont ensuite pondu l'architecture K7. (le K7 utilise le bus EV6 des CPU Alpha)
Java> non, pas performances redoutables. Correctes, en regard du prix, des désagréments techniques et surtout trop de recherche et de conception pour finalement peu d'applications sur le terrain.
Ceci dit, technologiquement parlant, ce n'est pas une bouse. Mais bon, tout le monde attendait bien mieux et au fond, c'est un peu le pétard mouillé d'Intel dans ce domaine...
Faut dire qu'au fond personne n'y croyait trop vu l'échec de toute les tentatives antérieures de rompre l'architecture et vu qu'on a su très vite qu'AMD ne choisirait pas cette voie. Le sort de l'itanium était scellé d'avance.
Le problème c'est que cette architecture demande une refonte totale des compilos et donc des investissements colossaux. Vu le risc d'échec élevé, il est probable que les investissements ont été insuffisants pour mettre à jour la puissance de l'architecture.
On peut dire aussi que le crusoe était un bel essai. Mais qu'on n'a malheureusement pas vu assez longtemps pour espérer voir un jour la puissance de son mode natif.
Mais ne vous faites pas d'illusions. On revera cette architecture dans le futur. Parce qu'a augmenter le nombre de cores et le parallélisme, cette architecture sera primordiale pour diminuer le nombre de transistors de chaque core et donc son dégagement thermique.