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Intel AVX : nouveau jeu d'instructions pour 2010
Source: Tom's Hardware – Catégorie : Processeurs 6 commentaires
IntelIntel est le premier fabricant mondial de microprocesseurs pour ordinateurs. Le terme Intel est issu de la contraction de « Integrated Electronics »).... a tenu cette après-midi une conférence, une sorte de mini-IDFIntel Developer Forum. Rencontre bi-annuelle à l’occasion de laquelle Intel présente à ses principaux partenaires et à la presse les évolutions à veni..., durant laquelle PatPAT est l’acronmyme du terme anglais "Page Attribute Table", une extension du système de gestion des pages mémoires qui permet de gérer finement la ma... Gelsinger, le vice président du fondeur, a présenté ses projets. Nous les détaillerons dans plusieurs actualités différentes, mais intéressons-nous pour l’instant à l’Intel AVX.
En 2010, Sandy Bridge
AVX, ou Advanced Vector Extensions, est le nouveau jeu d’instructions qu’Intel introduira en 2010 sur son processeurLe CPU, encore appelé processeur, est l’acronmye de « Central processing unit », en anglais. Ont pourrait traduire ce terme par unité centrale de trai... Sandy BridgeLes bridges sont la catégorie d’appareils photo intermédiaire entre les compacts et les reflex.
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Nehalem marque les d... en fin d’année. Le die-shrink en 32 nm de Nehalem, connu sous le nom de Westmere sortira en 2009, et il sera mis au placard par Sandy Bridge en 2010.
SSE XXL
Bref, AVX se présente comme un lointain descendant du MMX des premiers Pentium et une extension du jeu SSE du P4. Il s’agit d’un jeu d’instructions vectorielles pensé pour optimiser le traitement de nombres en virgule flottante, dont raffolent les applications "multimedia". La taille des instructions augmente, passant de 128 bits à 256 bits. Selon Intel cela se traduirait en puissance de calcul maximum en flottants multipliée par deux.
Ces nouvelles instructions pourront aussi gérer trois opérandes, au lieu de deux actuellement. Cela signifie moins de temps perdu. Aujourd’hui lorsqu’un Core 2 Duo réalise A +B, il doit stocker le résultat C à la place de B. Avec AVX, il pourrait disposer d’un troisième register indépendant pour C, et donc ne pas effacer B, et donc ne pas avoir à rechercher B en mémoire si jamais il a besoin pour la prochaine instruction.
Ce ne sont que quelques exemples et AVX recelle sans doute encore d’autres secrets. Intel les révèlera en détail lors de l’IDF de Shangaï, début avril.
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Wow... des instructions à trois opérandes.
C'est vraiment super... mais ça me rappelle vaguement quelque chose...
Ah oui, en fait Intel copie encore AMD et son SSE5, annoncé le 30 août 2007.
Encore bravo Intel... super...
"IDF de Shangaï" Shanghai
Tant qu'à moi, les ingénieurs d'AMD sont probablement les meilleurs (partis de chez Intel probablement) mais manquent de ressources techniques donc monétaire pour qu'ils puissent réaliser tout ce dont ils sont capables.
Donc, un boom de ''cash'' frais de disons 20 ou 30 milliards de dollars règlerais définitivement les problèmes de production, de livraison et d'ingénérie, pour bien faire face à la concurrence d'Intel? Je crois bien que oui!
Plus sérieusement, ya pas de "moi j'ai de meilleurs ingénieurs que toi, nananère", ce sont plutôt des problèmes de responsables stratégiques qui donnent (ou pas) les fonds pour explorer plus ou moins une voie de développement. Et vu que tout cela est très lié à la santé financière de l'entreprise ...
Ces instructions "pensées avant" par AMD c'est bien gentil, elles ont été financée par de longues recherches sur les bénéfices des Athlon 64 et X2, mais puisque maintenant les caisses sont vides, la mise en application va trainer. Intel à débloqué les budgets plus tard, mais ont peu penser que la frénésie core2 ne va pas s'effondrer au moins avant le nehalem, donc les budgets permettront de mettre en application cette nouvelle techno.
On critique souvent les ingénieurs (dont je ferais parti dans 18 mois si tout va bien), mais pourquoi le phenom est sorti buggué ? Budget de développement vidé, besoin de contrer le concurrent, et pas le temps/moyen de faire trop de testes. -> Et paf, on avait pas envisagé ce petit détaille qui fait planter le pross à haute utilisation.
A contrario on à Intel qui est pas meilleur en innovation, mais qui a encore du fric pour finaliser penryn. Donc on prend son temps, la première révision sort à une vitesse assez lamentable (pour les Q9 pas les QX9) et on prépare déjà une seconde révision sans trop paniquer.
AMD à tenu la tête d'Intel dans l'eau lorsque l'athlon 64 dominait largement le P4, mais de mauvais choix on été fait, l'avenir à été mal géré !
ça sera dur de remonter ça !
Pour en apprendre plus :
en VF : http://interstices.info/jcms/c_573 [...] delinquant
en VO : http://www.maa.org/mathland/mathland_5_12.html
Même le penryn à son bug ! Au niveau du FSB. Mais il est plus dur à provoquer que le TLB d'AMD.