Intel redesign les P4 EE et Xeon [MAJ]
Intel vient d'annoncer un changement dans le design de ses Xeon et Pentium 4 EE : l'ajout de 2 couches métalliques d'interconnections, portant leur nombre total à 8. Le reste demeure inchangé (finesse de gravure comme CPUID). Le but de la manoeuvre ? Augmenter les yields (pourcentage de CPU fonctionnels en sortie d'usine), et en conséquence, la disponibilité de ces CPU qui reste il est vrai assez aléatoire. Traditionnellement, l'ajout de plus de couches d'interconnections est réalisé pour ajouter des fonctionnalités à un CPU, ou pour obtenir un meilleur blindage. C'est cette dernière propriété qui est ici utilisée, et il est probable que ceci facilite également l'accès à des fréquences supérieures à 3.4 GHz, même si les propriétés thermiques restent elles inchangées. Les CPU concernés par ce changement sont les suivants :
- 3.2GHz Pentium 4 Extreme Edition (Hyper-Threading) — S-Spec SL7AA, M-0 stepping
- 3.4GHz Pentium 4 Extreme Edition (Hyper-Threading) — S-Spec SL7CH, M-0 stepping
- 3.06GHz Xeon — S-Spec SL72G, M-0 stepping
- 3.20GHz Xeon — S-Spec SL72Y, M-0 stepping
- 3.40GHz Xeon — S-Spec SL7D4, M-0 stepping
- 2.80GHz Xeon — S-Spec SL7D5, M-0 stepping
- 3.20GHz Xeon — S-Spec SL7AE, M-0 stepping
MAJ (17/03/2004 - 02 H) : X86-Secret (que nous saluons au passage) tient à nous informer que si l'on se réfère au site Processor Finder, le core Gallatin en est actuellement au stepping C0. Or, comme nous l'avons précisé plus haut, les CPU concernés par le changement de nombre de couches présentent le point commun de partager le stepping M0, soit celui du Prestonia/Northwood. Ceci contredirait donc l'hypothèse initiale selon laquelle les P4 EE et Xeon DP étaient basés sur le core Gallatin (ce qui semblait le plus logique), mais plutôt sur le core Prestonia.
Notre confrère laisse entendre que la distinction lui parait évidente, mais il affirmait pourtant initialement dans la même actualité que les P4 EE et Xeon étaient basés sur le core... Gallatin ! Preuve que la nature de ce core n'est peut-être pas si évidente...
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Neo ... et le IWH ?
Neo ... et le IWH ?
C uniquement quand le topic va etre close que je le pose...
oki ... là y'a plus de risques qu'il se face pourir que close
qui pourrait pourrir un tel topique?
"il est probable que ceci facilite également l'accès à des fréquences supérieures à 3.4 GHz" ... Intel et la course au Mhz ou comment avoir des PC de 3Ghz qui tourne comme des k6-2
"il est probable que ceci facilite également l'accès à des fréquences supérieures à 3.4 GHz" ... Intel et la course au Mhz ou comment avoir des PC de 3Ghz qui tourne comme des k6-2
6x86
6x86![[:maitre capello]](http://img.infos-du-net.com/forum/images/perso/maitre capello.gif)
![[:ddr555]](http://img.infos-du-net.com/forum/images/perso/ddr555.gif)
Silence toi
Silence toi![[:oth]](http://img.infos-du-net.com/forum/images/perso/oth.gif)
Les 6x86L étaient bien

Mwé, bon pas en virgule flottante, c'est vrai
Il y aurais pas une erreur ?
Augmenter le nombre de couche fait BAISSER les yields car la fabrication du proc est BCP plus compliqués.
quand AMD l'avait fait pour ses K7, c'était pour moins chauffer (chaleur mieux répartis) et augmenter les Mhz.
Parce qu'entre nous, les XEON ou P4EE n'ont pas besoin de super yields, ca coute cher, point.