L'AMD Torrenza est maintenant une idée absurde
Neal Robinson, directeur des solutions logiciels d’AMD, a affirmé lors d’un entretien au magazine X-bit labs, qu’installer une puce GPGPU sur un Socket destiné à un processeur x86 n’aurait aucun sens. Il prône une approche regroupant un processeur x86 et un circuit graphique sur un même die à l’instar des Fusion. Pourtant, il y a quelques années, AMD ne pensait pas qu’il s’agissait d’une si mauvaise idée que cela.
Une erreur de jeunesse
En 2006, AMD présentait son projet Torrenza (cf. « Torrenza : le coprocesseur à la sauce Opteron »). Destiné aux supercalculateurs et aux serveurs haut de gamme, il avait pour but de permettre l’intégration d’accélérateurs sur les Sockets pour Opteron. AMD ne ciblait pas directement les applications GPGPU, mais n’importe quelle puce accélératrice qui profiterait du bus HyperTransport. Des processeurs reconfigurables compatibles Torrenza avaient été présentés par SRC. Les premières machines sont sorties des usines en avril 2007 (cf. « Torrenza : du concept à la réalité ») et en septembre, nous apprenions que des grandes sociétés comme HP, RapidMind ou Activ Financial Systems en avaient fait acquisition (cf. « Torrenza arrive réellement chez AMD »). Depuis on n’entend plus parler.
Un défi trop important pour les développeurs
À lire entre les lignes du discours de M. Robinson, il semblerait que les craintes que nous soulevions en 2007 se soient avérées être le facteur déterminant dans la chute du projet. À l’époque, nous expliquions qu’il fallait développer de nouvelles applications qui tirent parti de ce système, mais que devant le manque de machines, il serait très difficile de motiver les programmeurs qui iraient, à leur tour, décourager les fabricants de puces. Aujourd’hui. M. Robinson affirme que du point de vue des développeurs de logiciels, l’intégration d’un GPU sur le die d’un CPU, comme le font les processeurs Fusion aujourd’hui, « a plus de sens ».
AMD n’était pas le seul à avoir cette idée et Intel semble toujours penser à un système permettant d’accueillir ses puces MIC (Many Integrated Core) Knights Ferry sur les Sockets de Xeon. Néanmoins, ce projet n’a pas encore dépassé le stade des laboratoires.
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