Des informations sur le Cortex A15
Des informations sur le Cortex A15 — le prochain CPU haut de gamme ARM — ont filtré récemment. Analysons. Ce processeur — successeur du Cortex A9 — se tourne en fait beaucoup vers le monde des serveurs.
Premièrement, ARM passe enfin la limite du 32 bits, avec un adressage mémoire sur 40 bits (soit 1 To de RAM au maximum). Comme sur les processeurs x86 32 bits destinés aux serveurs, c'est un système de pagination qui est utilisé : les applications ne voient que 4 Go, mais le système peut en gérer 1 To. Autre particularité « serveur », toute la mémoire interne (cache, registre) est ECC (ce qui est important dans le monde professionnel). Enfin, ARM va intégrer la virtualisation dans ses processeurs.
Pour le reste, ARM utilise un nouveau bus (AMBA 4) qui passe à 128 bits (c'est l'équivalent du FSB) et propose un cache variable en fonction des versions. En effet, le cache L2 varie de 512 ko à 4 Mo. Point intéressant, le Cortex A15 est doté de quatre cores et il est possible d'utiliser plusieurs processeurs sur la même machine (SMP). Les instructions classiques (deux unités NEON notamment) restent évidemment de la partie et le processeur est OoO (Out of Order), comme le Cortex A9 (et contrairement au Cortex A8).
Au niveau des fréquences, ARM espère 1,5 GHz sur une finesse de gravure 28/32 nm en LP (Low Power) et 2,5 GHz avec des procédés plus classiques. On peut considérer que le LP sera limité aux SoC destinés aux smartphones et autres tablettes alors que les autres modèles se destineront plus aux serveurs et aux appareils où la consommation n'est pas critique (Media Center, etc.) et où un TDP de 2 ou 3 W est acceptable.
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Rhaaaaaaaa 2.5 Ghz sur un ARM
Là, ça sent les possibilités de machine desktop intéressantes.
Bof. Même comme ça, ça reste un truc assez lent, les ARM sont pas fait pour du desktop, et on est plus proche d'une architecture Pentium/Pentium Pro que d'un Core i5
Ca c'est toi qui le dit ... Quand tu sais combien il faut de cycles d'horloges pour une instruction RISC et une instruction CISC
![[:tnz]](http://img.infos-du-net.com/forum/images/perso/tnz.gif)
Moi, j'dis un ARM à 2,5 Ghz ça équivaut à un Core/Phenom entre 7 et 9 Ghz.
Oui, enfin les x86, c'est du RISC en interne, hein. Les ARM actuels c'est pas très rapide ni efficaces, c'est simplement que ça consomme peu.
pourquoi un tel processeur dans un SmartPhone ?
à quoi sert la mémoire ECC, le support SMP ?
Bof. Même comme ça, ça reste un truc assez lent, les ARM sont pas fait pour du desktop
C'est clair, quad cores 2.5Ghz, c'est rien du tout.
et on est plus proche d'une architecture Pentium/Pentium Pro que d'un Core i5
Plus sérieusement, on est déja au dela d'un Atom qui équipe quelques PC.
pourquoi un tel processeur dans un SmartPhone ?à quoi sert la mémoire ECC, le support SMP ?
Parce que ces puces sont prévus pour des serveurs.
pourquoi un tel processeur dans un SmartPhone ?à quoi sert la mémoire ECC, le support SMP ?
parce que c'est plus pratique et flexible
l ECC permet de détecter et corriger des erreurs lors d'acces a la memoire
et le SMP comme il est marquer dans l article , c'est le fait de mettre plusieur processeur dans la même machine pour avoir plus de puissance
C'est clair, quad cores 2.5Ghz, c'est rien du tout.
Plus sérieusement, on est déja au dela d'un Atom qui équipe quelques PC.
Parce que ces puces sont prévus pour des serveurs.
Le quad-core, c'est pour un usage serveur basse conso, et de la fréquence et des cores, c'est pratique pour gérer du stockage, des réseaux, mais ça fait pas nécessairement un bon CPU desktop. Le desktop, dixit ARM même, est PAS la cible
Un A15 devrait être au niveau d'un Atom actuel, en gros, et un Atom, c'est architecturellement proche d'un Pentium plus que d'un Core 2 Duo, CQFD.
Pour cette version quad core, c'est certain que c'est prévu pour des serveurs.
Pour du desktop/netbook, les versions dual core sont suffisant, il est vrai, et la conso reste bien plus réduite.
Pour la comparaison avec l'Atom, tous les "bench" tenté (j'ai mis le premier trouvé sur google) mettent les dual core a8 devant l'Atom.
Là on parle d'une puce faisant un bon de dual à quad core + évolution d'une génération au moins. Je ne parle même pas de la fabrication qui va connaitre un bon énorme également.
http://blog.linleygroup.com/2010/0 [...] hmark.html
Oui, enfin les x86, c'est du RISC en interne, hein. Les ARM actuels c'est pas très rapide ni efficaces, c'est simplement que ça consomme peu.
Le bon sens ... il est où ?
Les x86 .... les rois de la techno CISC avec quelques centaines d’instructions câblées. Des instructions qui demandent 5 à 10 cycles d'horloge pour s’exécuter.
Le RISC dans les x86, je ne vois pas où il y en a. Le RISC est une approche, une façon de faire. Le RISC en interne des x86 (en supposant que ça existe vraiment), ce n'est que du marketing pour héler le chaland.
>Autre particularité « serveur », toute la mémoire interne (cache, registre) est ECC (ce qui est important dans le monde professionnel)
Un grand merci à Yannick pour m'avoir filer le lien.
les instructions x86 sont decomposées en microinstructions RISC depuis le pentium environ avec des unités de décodage. quand aux processeurs RISC, ils ont peu a peu integré des instructions complexes (et le X86 aussi avec le MMX, SSE1 a 4, etc). donc CISC et RISC n'ont aujourd'hui plus de sens, c'etait la gueguerre au debut des années 90.