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Source: Presence PC – Mots-clés : architecture, K10, AMD, Phenom
Catégories: Processeur
- 1 – Introduction
- 2 – Barcelona, une vue d’ensemble
- 3 – Une vue d’ensemble (suite) : réellement nouveau ?
- 4 – Lecture & décodage des instructions
- 5 – Suite : Analogie, prédiction de branchement
- 6 – Amélioration de la gestion de la pile
Suite : Analogie, prédiction de branchement
Dès le début nous constatons donc une divergence entre le Barcelona et le CoreUnité principale de calcul dans un processeur. Les principaux processeurs actuels regroupent désormais deux ou même quatre unités gravées dans la même... 2 : là où ce dernier mise sur la performance de crête, la nouvelle architecture d’AMDAMD est l’acronyme de « Advanced Micro Devices, Inc. ». Il s’agit d’un fabricant de semi-conducteurs basé à Sunnyvale en Californie. La réputation du... essaie à l’inverse de garantir une performance soutenue de premier plan. Pour faire une analogie avec le monde de l’automobile une telle différence pourrait s’illustrer entre un véhicule ayant une vitesse de pointe de 200 km/h mais ne pouvant l’atteindre que dans des cas très spécifiques (longue ligne droite, sol non mouillé, revêtement adéquat) et devant parfois rouler à 100 km/h face à un autre ne dépassant pas les 150 km/h mais pouvant assurer cette vitesse dans des situations plus nombreuses que le précédent.
Une autre amélioration apportée au front-end du processeurLe CPU, encore appelé processeur, est l’acronmye de « Central processing unit », en anglais. Ont pourrait traduire ce terme par unité centrale de trai... concerne la prédiction de branchementLa prédiction de branchement consiste à essayer d’éviter les aléas dans un pipeline, c’est-à-dire réduire la perte de cycles induite par un branchemen.... Les ingénieurs d’AMD se sont inspirés des travaux d’IntelIntel est le premier fabricant mondial de microprocesseurs pour ordinateurs. Le terme Intel est issu de la contraction de « Integrated Electronics »).... qui a investit énormément d’efforts à ce sujet particulièrement critique sur les processeurs à long pipelineUn pipeline est une succession d’opérations matérielles ou logicielles. Les différents étages du pipeline sont connectés en série : la sortie d’un éta.... Ainsi avec le Prescott on a vu l’apparition d’un nouveau prédicteur de branchement dédié aux branchements indirects qui a ensuite été intégré au Pentium M et à toutes ses déclinaisons. Mais quelle est la différence entre un branchement classique et un branchement indirect ? Et bien c’est simple dans un branchement classique la cible est connue et ne varie pas, en d’autres termes on demande au processeur de continuer l’exécution du programme à l’adresse mémoire x, x étant une constante. A l’inverse dans un branchement indirect la cible n’est pas connue, c’est une variable stockée en mémoire. On demande donc au processeur de continuer l’exécution du programme à l’adresse contenue à l’adresse mémoire y.
AMD a donc ajouté un prédicteur dédié à ce type de branchements pouvant stocker jusqu’à 512 valeurs. Mais ce n’est pas tout, les ingénieurs ont aussi amélioré la prédiction de branchement de façon plus générale en augmentant le nombre de branchements dont le processeur peut conserver les résultats (pris ou pas pris). Il n’y a rien de magique avec la prédiction de branchement : plus la taille de l’historique est grande meilleure sera la prédiction.
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On voit les efforts de l'equipe d'AMD et cela semble encourageant pour les futures perf' des Barcelona
La question que je me pose est au niveau des jeux d'instructions. Outre les optimisations purement hardware qui sont transparentes du point de vue software, à quel moment le nouveau jeu d'instructions est pris en compte?
Est-ce lors de la compilation avec un linker dépendant de chaque architecture?
Est-ce lors de l'installation du programme sur la machine cible?
Ou est-ce totalement transparent du point de vue du programme tiers et c'est alors l'os qui s'occupe d'optimiser le code pour prendre en compte les nouvelles instructions disponible?
Peut-être est-ce le processeur lors du décodage des instructions x86 qui détecte qu'une émulation possible peut-être faite avec les nouvelles instructions?
Je dois avouer que je ne comprends pas vraiment comment cela ce passe, dans le monde des microcontrôleurs c'est beaucoup plus simple
Ca me rappelle mes cours ou notre prof nous disait, vous voyez vous avez tout en main pour faire un processeur (tout ca parcqu'on arrivait à faire des additionneurs 8bits en vhdl^^)
Alors que la gestion des horloges est indépendantes... maikilsoncon... Il perde une occasion de bien faire descendre la consomation. J'imagine que seul la version portable pourra le faire...
ca dépend des programmes.
Globalement, en général on propose les optimisations à part sur certains calculs, avec le choix dans le programme (soit à la main, rare, soit en détectant si le CPU le fait). C'est surtout sur des programmes qui n'utilisent pas intensivement les instructions en question. On a donc au moins deux versions différentes du code : une SSE (par exemple) et une autre.
L'autre possibilité, c'est de limiter le programme à un jeu d'instruction minimum. C'est rare, parce que du coup ça limite le nombre de CPU utilisables : faut un parc installé important. On a de plus en plus de programme qui nécessitent le SSE(2) actuellement parce que la majorité des CPU actuels le sont.
Sinon, y a les programmes qui proposent plusieurs exécutables : un par type d'instruction, mais c'est chiant pour l'utilisateur.
l'OS n'est pas capable de définir les instructions à utiliser (et n'est en général pas optimisé pour des jeux en particulier) et le processeur n'est normalement pas capable de détecter les instructions.
Pour ce qui est du délai et du saut d'appellation, n'y a-t-il pas eu une architecture K9, abandonnée il y a environ 18 mois pour une cause inconnue ? (manque de performance, problèmes de fabrications, de brevet ?)
l'OS n'est pas capable de définir les instructions à utiliser (et n'est en général pas optimisé pour des jeux en particulier) et le processeur n'est normalement pas capable de détecter les instructions.
i386, i586, i686 ce n'est pas adapter le l'OS à un jeu en particulier ? (bien sur il y a plus de jeux d'instructionsque ca).
Les instructions à utiliser sont également choisit par le compilateur lors de la compilation non ? (bien sur il faut dire au compilateur qu'elles instructions notre proc supporte).
même si je ne comprends pas tout
bravo a l'équipe de PPC.
Ca me rappelle mes cours ou notre prof nous disait, vous voyez vous avez tout en main pour faire un processeur (tout ca parcqu'on arrivait à faire des additionneurs 8bits en vhdl^^)
Ha ben on a eu le même.
i386, i586, i686 ce n'est pas adapter le l'OS à un jeu en particulier ? (bien sur il y a plus de jeux d'instructionsque ca).
Les instructions à utiliser sont également choisit par le compilateur lors de la compilation non ? (bien sur il faut dire au compilateur qu'elles instructions notre proc supporte).
oui, pour Linux, tu peux limiter au CPU minimum, mais c'est pas nécessairement le cas.
les instructions sont choisies par le compilateur en fonction de ce qu'on lui demande, mais tu peux lui mettre plusieurs versions dans le programme (avec un choix, manuel ou automatique)
en général, on a quand même tendance a faire du code le "moins" optimisé possible pour garder une compatibilité correcte : on se limite par exemple au i686 avec MMX (ce qui doit représenter une bonne partie des machines actuelles)
Maintenant, si t'as du code qui va tourner sur une machine que tu connais bien, tu peux optimiser avec ce que le CPU supporte (ex. Gentoo qui peut être compilé en fonction de la machine).
Fraye > Quels passages ne comprends tu pas ?
l'article est trés bien fait et tout et tout..
bonnes explications.. ça se voit
ca vient plus de moi qui même quand il y a toutes les explications possibles
n'arrive plus a suivre techniquement.